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Logic Synthesis and Verification Algorithms A. N. Netravali , F. Somenzi , G.D. Hachtel Logic Synthesis and Verification Algorithms is a textbook designed for courses on VLSI Logic Synthesis and Verification, Design Automation, CAD and advanced level discrete mathematics. It also... Editeur : Kluwer Academic Publishers Parution : 1996 PDF 156,49 € J'achète Téléchargement immédiat Dès validation de votre commande

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